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Cxad33112a cxad33112b cxad33112c is a 14 bit, dual channel, 125 MSPs analog-to-digital converter (ADC) designed to support communication applications requiring high performance low cost

This dual channel ADC core adopts multi-level, differential pipeline architecture. Each ADC has a wide bandwidth, differential sample and hold analog input amplifier, which supports a variety of user selectable input ranges. The integrated reference voltage source can simplify the design. The duty cycle stabilizer can be used to compensate for the fluctuation of ADC clock duty cycle, so that the converter can maintain excellent performance

Cxad33112a cxad33112b cxad33112c is a 14 bit, dual channel, 125 MSPs analog-to-digital converter (ADC) designed to support communication applications requiring high performance low cost
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Product introduction

目录

1.产品概述       2.产品特点     Qlh嘉泰姆

3.应用范围       4.技术规格书下载(PDF文档)Qlh嘉泰姆

5.产品封装       6.电路原理图  Qlh嘉泰姆

7.相关产品Qlh嘉泰姆

   产品概述 返回TOPQlh嘉泰姆


        CXAD33112A CXAD33112B CXAD33112C是一款14位、双通道、125 MSPS的模数转换器(ADC),旨在支持需要高性能、低成本、小尺寸且具多功能性的通信应用。这款双通道ADC内核采用多级、差分流水线架构。每个ADC均具有宽带宽、差分采样保持模拟输入放大器,支持用户可选的各种输入范围。集成基准电压源可简化设计。占空比稳定器可用来补偿ADC时钟占空比的波动,使转换器保持出色的性能。SYNC输入允许多个芯片的同步。需要时,灵活的掉电选项可以明显降低功耗。 采用1.8 V单电源供电,数字输出驱动器则采用独立电源供电,以支持1.8 V CMOS或LVDS输出。 设置与控制的编程利用三线式SPI兼容型串行接口来完成。 CXAD33112A CXAD33112B CXAD33112C采用64引脚QFN封装,额定温度范围为−55°C至+125°C

   产品特点 返回TOPQlh嘉泰姆


     最高采样速率:125 MSPSQlh嘉泰姆

信噪比(SNR):76dBFS @ 10MHz and 125MSPSQlh嘉泰姆

无杂散动态范围(SFDR):85dBc @ 10MHz and 125MSPSQlh嘉泰姆

中频采样频率可达 300MHzQlh嘉泰姆

1.8V 单电源供电Qlh嘉泰姆

低功耗:796mW (125 MSPS)Qlh嘉泰姆

1.8V CMOS或LVDS输出Qlh嘉泰姆

1至8整数输入时钟分频器Qlh嘉泰姆

集成ADC时钟占空比稳定器Qlh嘉泰姆

多芯片同步功能Qlh嘉泰姆

可编程ADC内部基准电压源Qlh嘉泰姆

灵活的模拟输入范围:1.0V峰峰值至2.0V峰峰值Qlh嘉泰姆

节能的掉电模式Qlh嘉泰姆

大于90dB的通道隔离度Qlh嘉泰姆

串行端口控制Qlh嘉泰姆

与AD9258系列引脚兼容Qlh嘉泰姆

   应用范围 返回TOPQlh嘉泰姆


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   技术规格书(产品PDF) 返回TOP Qlh嘉泰姆


     需要详细的PDF规格书请扫一扫微信联系我们,还可以获得免费样品以及技术支持!Qlh嘉泰姆

 QQ截图20160419174301.jpgQlh嘉泰姆

产品封装图 返回TOPQlh嘉泰姆


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电路原理图 返回TOPQlh嘉泰姆


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高速高精度ADC系列(ADC)Qlh嘉泰姆

Part No.Qlh嘉泰姆

分辨率Qlh嘉泰姆

采样率Qlh嘉泰姆

通道数Qlh嘉泰姆

INLQlh嘉泰姆

DNLQlh嘉泰姆

满幅输入范围Qlh嘉泰姆

SNRQlh嘉泰姆

SFDRQlh嘉泰姆

Power ConsumptionQlh嘉泰姆

数据Qlh嘉泰姆

输出接口Qlh嘉泰姆

PackageQlh嘉泰姆

CXAD33112AQlh嘉泰姆

14bitQlh嘉泰姆

125Qlh嘉泰姆

2Qlh嘉泰姆

±2LSBQlh嘉泰姆

±0.25LSBQlh嘉泰姆

2Qlh嘉泰姆

76dBFSQlh嘉泰姆

>85dBcQlh嘉泰姆

796mWQlh嘉泰姆

CMOS/LVDSQlh嘉泰姆

QFN64Qlh嘉泰姆

CXAD33112BQlh嘉泰姆

14bitQlh嘉泰姆

155Qlh嘉泰姆

2Qlh嘉泰姆

±2LSBQlh嘉泰姆

±0.25LSBQlh嘉泰姆

2Qlh嘉泰姆

75.5dBFSQlh嘉泰姆

>91dBcQlh嘉泰姆

820mWQlh嘉泰姆

CMOSQlh嘉泰姆

QFN64Qlh嘉泰姆

CXAD33112CQlh嘉泰姆

14bitQlh嘉泰姆

80Qlh嘉泰姆

2Qlh嘉泰姆

±1.5LSBQlh嘉泰姆

±0.5LSBQlh嘉泰姆

2Qlh嘉泰姆

76.5dBFSQlh嘉泰姆

>88dBcQlh嘉泰姆

477mWQlh嘉泰姆

CMOS/LVDSQlh嘉泰姆

QFN64Qlh嘉泰姆

CXAD33113AQlh嘉泰姆

14bitQlh嘉泰姆

125Qlh嘉泰姆

4Qlh嘉泰姆

±2LSBQlh嘉泰姆

±0.5LSBQlh嘉泰姆

2Qlh嘉泰姆

76.4dBFSQlh嘉泰姆

>84.4dBcQlh嘉泰姆

580mWQlh嘉泰姆

Serial LVDSQlh嘉泰姆

QFN48Qlh嘉泰姆

CXAD33113BQlh嘉泰姆

14bitQlh嘉泰姆

80Qlh嘉泰姆

4Qlh嘉泰姆

±1LSBQlh嘉泰姆

±0.4LSBQlh嘉泰姆

2Qlh嘉泰姆

76.6dBFSQlh嘉泰姆

>85.5dBcQlh嘉泰姆

525mWQlh嘉泰姆

Serial LVDSQlh嘉泰姆

QFN48Qlh嘉泰姆

CXAD33114AQlh嘉泰姆

16bitQlh嘉泰姆

125Qlh嘉泰姆

2Qlh嘉泰姆

±4.5LSBQlh嘉泰姆

±0.5LSBQlh嘉泰姆

2Qlh嘉泰姆

77dBFSQlh嘉泰姆

>90dBcQlh嘉泰姆

796mWQlh嘉泰姆

CMOS/LVDSQlh嘉泰姆

QFN64Qlh嘉泰姆

CXAD33114BQlh嘉泰姆

16bitQlh嘉泰姆

80Qlh嘉泰姆

2Qlh嘉泰姆

±4.5LSBQlh嘉泰姆

±0.5LSBQlh嘉泰姆

2Qlh嘉泰姆

77.5dBFSQlh嘉泰姆

>90dBcQlh嘉泰姆

477mWQlh嘉泰姆

CMOS/LVDSQlh嘉泰姆

QFN64Qlh嘉泰姆

CXAD33115AQlh嘉泰姆

16bitQlh嘉泰姆

125Qlh嘉泰姆

4Qlh嘉泰姆

±2.2LSBQlh嘉泰姆

±0.25LSBQlh嘉泰姆

2.8Qlh嘉泰姆

81.1dBFSQlh嘉泰姆

>94.7dBcQlh嘉泰姆

832mWQlh嘉泰姆

JESD204BQlh嘉泰姆

QFN56Qlh嘉泰姆

CXAD33115BQlh嘉泰姆

16bitQlh嘉泰姆

125Qlh嘉泰姆

4Qlh嘉泰姆

±4.5LSBQlh嘉泰姆

±0.7LSBQlh嘉泰姆

2Qlh嘉泰姆

78.6dBFSQlh嘉泰姆

>90dBcQlh嘉泰姆

630mWQlh嘉泰姆

Serial LVDSQlh嘉泰姆

QFN48Qlh嘉泰姆